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  • DS90LV028A 3V、LVDSデュアルCMOS差動入力ライン・レシーバ

    • JAJS575F June   1998  – June 2016 DS90LV028A

      PRODUCTION DATA.  

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  • DS90LV028A 3V、LVDSデュアルCMOS差動入力ライン・レシーバ
  1. 1 特長
  2. 2 アプリケーション
  3. 3 概要
  4. 4 改訂履歴
  5. 5 Pin Configuration and Functions
  6. 6 Specifications
    1. 6.1 Absolute Maximum Ratings
    2. 6.2 ESD Ratings
    3. 6.3 Recommended Operating Conditions
    4. 6.4 Thermal Information
    5. 6.5 Electrical Characteristics
    6. 6.6 Switching Characteristics
    7. 6.7 Typical Characteristics
  7. 7 Parameter Measurement Information
  8. 8 Detailed Description
    1. 8.1 Overview
    2. 8.2 Functional Block Diagram
    3. 8.3 Feature Description
      1. 8.3.1 Fail-Safe Feature
      2. 8.3.2 Cables and Connectors
    4. 8.4 Device Functional Modes
  9. 9 Application and Implementation
    1. 9.1 Application Information
    2. 9.2 Typical Application
      1. 9.2.1 Design Requirements
      2. 9.2.2 Detailed Design Procedure
        1. 9.2.2.1 Probing LVDS Transmission Lines
        2. 9.2.2.2 Threshold
      3. 9.2.3 Application Curve
  10. 10Power Supply Recommendations
  11. 11Layout
    1. 11.1 Layout Guidelines
      1. 11.1.1 Differential Traces
      2. 11.1.2 Termination
    2. 11.2 Layout Examples
  12. 12デバイスおよびドキュメントのサポート
    1. 12.1 ドキュメントのサポート
      1. 12.1.1 関連資料
    2. 12.2 ドキュメントの更新通知を受け取る方法
    3. 12.3 コミュニティ・リソース
    4. 12.4 商標
    5. 12.5 静電気放電に関する注意事項
    6. 12.6 Glossary
  13. 13メカニカル、パッケージ、および注文情報
  14. 重要なお知らせ

パッケージ・オプション

メカニカル・データ（パッケージ｜ピン）
  • D|8
    • MSOI002K
  • NGN|8
    • MPDS401A
サーマルパッド・メカニカル・データ
発注情報
  • jajs575f_oa
  • jajs575f_pm
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DATA SHEET

DS90LV028A 3V、LVDSデュアルCMOS差動入力ライン・レシーバ

このリソースの元の言語は英語です。 翻訳は概要を便宜的に提供するもので、自動化ツール (機械翻訳) を使用していることがあり、TI では翻訳の正確性および妥当性につきましては一切保証いたしません。 実際の設計などの前には、ti.com で必ず最新の英語版をご参照くださいますようお願いいたします。

1 特長

  • 400Mbps (200MHz)を超えるスイッチング速度
  • 差動スキュー: 50ps (標準値)
  • チャネル間スキュー: 0.1ns (標準値)
  • 最大伝搬遅延: 2.5ns
  • 3.3V電源の設計
  • フロースルーのピン配置
  • パワーダウン時高インピーダンスのLVDS入力
  • 低消費電力の設計(3.3V静的で18mW)
  • 既存の5V LVDSネットワークと相互運用可能
  • 小振幅(標準値350mV)差動信号レベルを許容
  • 開放、短絡、終端の入力フェイルセーフに対応
  • ANSI/TIA/EIA-644規格に準拠
  • 工業用温度範囲: -40℃～85℃
  • SOICおよび省スペースのWSONパッケージで供給

2 アプリケーション

  • 多機能プリンタ
  • LVDS-LVCMOS間の変換
  • ビル・オートメーションとファクトリ・オートメーション
  • グリッド・インフラストラクチャ

3 概要

DS90LV028AはデュアルCMOS差動ライン・レシーバで、超低消費電力、低ノイズ、高いデータ速度を必要とするアプリケーション用に設計されています。このデバイスは、低電圧差動信号(LVDS)テクノロジを活用し、400Mbps (200MHz)を超えるデータ速度をサポートするよう設計されています。

DS90LV028Aは低電圧(標準値350mV)の差動入力信号を受信し、3V CMOS出力レベルへ変換します。また、レシーバは開放、短絡、終端(100Ω)の入力フェイルセーフもサポートします。すべてのフェイルセーフ条件において、レシーバの出力はHIGHになります。DS90LV028Aにはフロースルー設計が採用されているため、PCBレイアウトが容易です。

DS90LV028Aと、対になるLVDSライン・ドライバは、消費電力の大きいPECL/ECLデバイスの代替として、高速のポイント・ツー・ポイント・インターフェイス・アプリケーションに使用できます。

製品情報(1)

型番 パッケージ 本体サイズ(公称)
DS90LV028A SOIC (8) 4.90mm×3.91mm
WSON (8) 4.00mm×4.00mm
  1. 提供されているすべてのパッケージについては、巻末の注文情報を参照してください。

機能図

DS90LV028A 10007702.gif

4 改訂履歴

Changes from E Revision (April 2013) to F Revision

  • 「ESD定格」の表、「機能説明」セクション、「デバイスの機能モード」セクション、「アプリケーションと実装」セクション、「電源に関する推奨事項」セクション、「レイアウト」セクション、「デバイスおよびドキュメントのサポート」セクション、「メカニカル、パッケージ、および注文情報」セクションを追加Go
  • Added Thermal Information valuesGo

Changes from D Revision (April 2013) to E Revision

  • Changed ナショナル・セミコンダクターのデータシートのレイアウトをTIフォーマットへGo

5 Pin Configuration and Functions

D Package
8-Pin SOIC
Top View
DS90LV028A 10007701.png
NGN Package
8-Pin WSON
Top View
DS90LV028A 10007725.png

Pin Functions

PIN I/O DESCRIPTION
NAME NO.
GND 5 — Ground pin
RIN+ 2, 3 I Noninverting receiver input pin
RIN– 1, 4 I Inverting receiver input pin
ROUT 6, 7 O Receiver output pin
VCC 8 — Power supply pin, 3.3 V ±0.3 V

 
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