CD74ACT175
- 输入兼容 TTL 电压
- 包含四个具有双轨输出的触发器
- 缓冲输入
- 双极 F、AS 和 S 的速度，同时功耗显著降低
- 平衡传播延迟
- ±24mA 输出驱动电流
- 扇出至 15 个 F 器件
- 防 SCR 闩锁 CMOS 工艺和电路设计
这款正边沿触发式 D 类触发器具有一个直接清零 (CLR) 输入。CD74ACT175 器件具有每个触发器的互补输出。
技术文档
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|---|---|---|---|---|---|---|
| * | 数据表 | CD74ACT175 具有清零功能的四路 D 类触发器 数据表 (Rev. A) | PDF | HTML | 英语版 (Rev.A) | PDF | HTML | 2024年 5月 8日 |
| 应用手册 | Power-Up Behavior of Clocked Devices (Rev. B) | PDF | HTML | 2022年 12月 15日 | |||
| 应用手册 | Implications of Slow or Floating CMOS Inputs (Rev. E) | 2021年 7月 26日 | ||||
| 选择指南 | Logic Guide (Rev. AB) | 2017年 6月 12日 | ||||
| 应用手册 | Understanding and Interpreting Standard-Logic Data Sheets (Rev. C) | 2015年 12月 2日 | ||||
| 选择指南 | 逻辑器件指南 2014 (Rev. AA) | 最新英语版本 (Rev.AB) | 2014年 11月 17日 | |||
| 用户指南 | LOGIC Pocket Data Book (Rev. B) | 2007年 1月 16日 | ||||
| 应用手册 | 选择正确的电平转换解决方案 (Rev. A) | 英语版 (Rev.A) | 2006年 3月 23日 | |||
| 应用手册 | Semiconductor Packing Material Electrostatic Discharge (ESD) Protection | 2004年 7月 8日 | ||||
| 应用手册 | TI IBIS File Creation, Validation, and Distribution Processes | 2002年 8月 29日 | ||||
| 应用手册 | CMOS Power Consumption and CPD Calculation (Rev. B) | 1997年 6月 1日 | ||||
| 应用手册 | 使用逻辑器件进行设计 (Rev. C) | 1997年 6月 1日 | ||||
| 应用手册 | Using High Speed CMOS and Advanced CMOS in Systems With Multiple Vcc | 1996年 4月 1日 |
设计和开发
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评估板
14-24-LOGIC-EVM — 采用 14 引脚至 24 引脚 D、DB、DGV、DW、DYY、NS 和 PW 封装的逻辑产品通用评估模块
14-24-LOGIC-EVM 评估模块 (EVM) 旨在支持采用 14 引脚至 24 引脚 D、DW、DB、NS、PW、DYY 或 DGV 封装的任何逻辑器件。
| 封装 | 引脚 | CAD 符号、封装和 3D 模型 |
|---|---|---|
| PDIP (N) | 16 | Ultra Librarian |
| SOIC (D) | 16 | Ultra Librarian |
订购和质量
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