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SN74AUP1T08

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低功耗、1.8/2.5/3.3V 输入、3.3V CMOS 输出、2 输入正与门

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产品详情

Technology family AUP1T Number of channels 1 Vout (min) (V) 2.3 Vout (max) (V) 3.6 Data rate (max) (Mbps) 200 IOH (max) (mA) -4 IOL (max) (mA) 4 Supply current (max) (µA) 0.9 Features Over-voltage tolerant inputs, Partial power down (Ioff), Single supply, Voltage translation Input type Schmitt-Trigger Output type Balanced CMOS, Push-Pull Operating temperature range (°C) -40 to 85
Technology family AUP1T Number of channels 1 Vout (min) (V) 2.3 Vout (max) (V) 3.6 Data rate (max) (Mbps) 200 IOH (max) (mA) -4 IOL (max) (mA) 4 Supply current (max) (µA) 0.9 Features Over-voltage tolerant inputs, Partial power down (Ioff), Single supply, Voltage translation Input type Schmitt-Trigger Output type Balanced CMOS, Push-Pull Operating temperature range (°C) -40 to 85
SOT-SC70 (DCK) 5 4.2 mm² 2 x 2.1
  • 静电放电 (ESD) 性能测试符合 JESD 22 标准
    • 2000V 人体放电模型{1}（A114-B，II 类）
    • 1000V 充电器件模型 (C101)
  • 单电源电压转换器
  • 输出电平高达电源 VCCCMOS 电平
    • 1.8V 至 3.3V（VCC=3.3V 时）
    • 2.5V 至 3.3V（VCC=3.3V 时）
    • 1.8V 至 2.5V（VCC=2.5V 时）
    • 3.3V 至 2.5V（VCC=2.5V 时）
  • 施密特触发器输入可抑制输入噪声并提供更佳的输出信号完整性
  • I关闭支持部分断电 (VCC=0)
  • 超低静态功耗： 0.1µA
  • 超低动态功耗： 0.9µA
  • 闩锁性能超过 100mA，符合 JESD 78 II 类规范的要求
  • 可提供无铅封装：SC70 (DCK) 2 x 2.1 x 0.65mm（高 1.1mm）
  • 有关更多逻辑门选项，请访问 www.ti.com/littlelogic
  • 静电放电 (ESD) 性能测试符合 JESD 22 标准
    • 2000V 人体放电模型{1}（A114-B，II 类）
    • 1000V 充电器件模型 (C101)
  • 单电源电压转换器
  • 输出电平高达电源 VCCCMOS 电平
    • 1.8V 至 3.3V（VCC=3.3V 时）
    • 2.5V 至 3.3V（VCC=3.3V 时）
    • 1.8V 至 2.5V（VCC=2.5V 时）
    • 3.3V 至 2.5V（VCC=2.5V 时）
  • 施密特触发器输入可抑制输入噪声并提供更佳的输出信号完整性
  • I关闭支持部分断电 (VCC=0)
  • 超低静态功耗： 0.1µA
  • 超低动态功耗： 0.9µA
  • 闩锁性能超过 100mA，符合 JESD 78 II 类规范的要求
  • 可提供无铅封装：SC70 (DCK) 2 x 2.1 x 0.65mm（高 1.1mm）
  • 有关更多逻辑门选项，请访问 www.ti.com/littlelogic

SN74AUP1T08 执行布尔函数 Y = A • B or Y = /A + /B，专门用于逻辑电平转换应用，在此类应用中输出以电源 VCC 为基准。

AUP 技术是行业最低功耗逻辑技术，此技术设计用于扩展运行中的电池寿命。所有接受 1.8V LVCMOS 信号的输入电平，同时由一个单 3.3V 或 2.5V VCC电源供电运行。该产品还可以保持出色的信号完整性（请见Figure 5-1和Figure 5-2）。

2.3V 至 3.6V 的宽 VCC范围有可能实现开关输出电平连接至外部控制器或处理器。

施密特触发器输入（正负输入转换之间的 ΔVT=210mV）改进了开关转换期间的抗扰度，这对于模拟混合模式设计十分有用。施密特触发器输入抑制输入噪声、确保输出信号的完整性并可实现慢输入信号转换。

I关闭特性可实现省电条件 (VCC=0V) ，这在便携式和移动应用中十分重要。当 VCC=0V 时，介于 0V 至 3.6V 范围内的信号可被施加到器件的输入和输出上。在这些条件下，不会对器件造成损坏。

SN74AUP1T08 经设计优化具有 4mA 电流驱动能力，可减少由高驱动输出导致的线路反射、过冲和下冲。

SN74AUP1T08 执行布尔函数 Y = A • B or Y = /A + /B，专门用于逻辑电平转换应用，在此类应用中输出以电源 VCC 为基准。

AUP 技术是行业最低功耗逻辑技术，此技术设计用于扩展运行中的电池寿命。所有接受 1.8V LVCMOS 信号的输入电平，同时由一个单 3.3V 或 2.5V VCC电源供电运行。该产品还可以保持出色的信号完整性（请见Figure 5-1和Figure 5-2）。

2.3V 至 3.6V 的宽 VCC范围有可能实现开关输出电平连接至外部控制器或处理器。

施密特触发器输入（正负输入转换之间的 ΔVT=210mV）改进了开关转换期间的抗扰度，这对于模拟混合模式设计十分有用。施密特触发器输入抑制输入噪声、确保输出信号的完整性并可实现慢输入信号转换。

I关闭特性可实现省电条件 (VCC=0V) ，这在便携式和移动应用中十分重要。当 VCC=0V 时，介于 0V 至 3.6V 范围内的信号可被施加到器件的输入和输出上。在这些条件下，不会对器件造成损坏。

SN74AUP1T08 经设计优化具有 4mA 电流驱动能力，可减少由高驱动输出导致的线路反射、过冲和下冲。
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评估板

5-8-LOGIC-EVM — 支持 5 至 8 引脚 DCK、DCT、DCU、DRL 和 DBV 封装的通用逻辑评估模块

灵活的 EVM 设计用于支持具有 5 至 8 引脚数且采用 DCK、DCT、DCU、DRL 或 DBV 封装的任何器件。
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