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TLV2352

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デュアル、低電圧、LinCMOS™ 差動コンパレータ

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製品詳細

Number of channels 2 Output type Open-collector, Open-drain Propagation delay time (µs) 0.65 Vs (max) (V) 8 Vs (min) (V) 2 Rating Catalog Iq per channel (typ) (mA) 0.07 Vos (offset voltage at 25°C) (max) (mV) 5 Rail-to-rail In to V- Operating temperature range (°C) -40 to 85 Input bias current (±) (max) (nA) 2 VICR (max) (V) 7 VICR (min) (V) 0
Number of channels 2 Output type Open-collector, Open-drain Propagation delay time (µs) 0.65 Vs (max) (V) 8 Vs (min) (V) 2 Rating Catalog Iq per channel (typ) (mA) 0.07 Vos (offset voltage at 25°C) (max) (mV) 5 Rail-to-rail In to V- Operating temperature range (°C) -40 to 85 Input bias current (±) (max) (nA) 2 VICR (max) (V) 7 VICR (min) (V) 0
PDIP (P) 8 92.5083 mm² 9.81 x 9.43 SOIC (D) 8 29.4 mm² 4.9 x 6 TSSOP (PW) 8 19.2 mm² 3 x 6.4
  • 広い電源電圧範囲：2V ～ 8V
  • 広い電源電圧範囲：2.7V ～ 8V (TLV2352IDR および TLV2352IPWR のみ)
  • 3V および 5V で完全に特性評価済み
  • 超低電源電流ドレイン：3V で 120µA (標準値)
  • TTL、MOS、CMOS 互換出力
  • 迅速な応答時間：TTL レベル入力ステップで標準値 200ns
  • 高い入力インピーダンス：1012Ω (標準値)
  • きわめて低い入力バイアス電流：5pA (標準値)
  • 同相入力電圧範囲にグランドを含む
  • 内蔵 ESD 保護機能
  • 広い電源電圧範囲：2V ～ 8V
  • 広い電源電圧範囲：2.7V ～ 8V (TLV2352IDR および TLV2352IPWR のみ)
  • 3V および 5V で完全に特性評価済み
  • 超低電源電流ドレイン：3V で 120µA (標準値)
  • TTL、MOS、CMOS 互換出力
  • 迅速な応答時間：TTL レベル入力ステップで標準値 200ns
  • 高い入力インピーダンス：1012Ω (標準値)
  • きわめて低い入力バイアス電流：5pA (標準値)
  • 同相入力電圧範囲にグランドを含む
  • 内蔵 ESD 保護機能

TLV2352 は、単一電源アプリケーション向けに特別に設 計された、独立した 2 つのローパワー コンパレータで構 成されており、最小 2V (TLV2352IDR および TLV2352IPWR のみ最小 2.7V) の電源レールでの動作 に対応しています。3V の電源で駆動した場合、典型的な 電源電流はわずか 120µA です。

TLV2352 はテキサス・インスツルメンツの CMOS テクノロ ジーを用いて設計されており、その結果、非常に高い入力 インピーダンス (通常 1012Ω を超える) を実現しており、高 インピーダンスソースとの直接インターフェイスが可能で す。出力は N チャネルのオープン ドレイン構成であり、正 の出力電圧スイングを得るために外部プルアップ抵抗が 必要です。また、正論理のワイヤード AND 接続を構成す ることが可能です。TLV2352I は、-40℃ ～ 85℃、3V お よび 5V で動作が完全に特性評価されています。 TLV2352M は、-55℃ ～ 125℃、3V および 5V で動作 が完全に特性評価されています。

TLV2352 には静電放電 (ESD) 保護回路が内蔵されて おり、人体モデル・テストにより 1000V ESD 定格に分類さ れています。ただし、ESD にさらされるとデバイス パラメト リック性能が低下する可能性があるため、このデバイスを 取り扱う際には注意を払う必要があります。

TLV2352 は、単一電源アプリケーション向けに特別に設 計された、独立した 2 つのローパワー コンパレータで構 成されており、最小 2V (TLV2352IDR および TLV2352IPWR のみ最小 2.7V) の電源レールでの動作 に対応しています。3V の電源で駆動した場合、典型的な 電源電流はわずか 120µA です。

TLV2352 はテキサス・インスツルメンツの CMOS テクノロ ジーを用いて設計されており、その結果、非常に高い入力 インピーダンス (通常 1012Ω を超える) を実現しており、高 インピーダンスソースとの直接インターフェイスが可能で す。出力は N チャネルのオープン ドレイン構成であり、正 の出力電圧スイングを得るために外部プルアップ抵抗が 必要です。また、正論理のワイヤード AND 接続を構成す ることが可能です。TLV2352I は、-40℃ ～ 85℃、3V お よび 5V で動作が完全に特性評価されています。 TLV2352M は、-55℃ ～ 125℃、3V および 5V で動作 が完全に特性評価されています。

TLV2352 には静電放電 (ESD) 保護回路が内蔵されて おり、人体モデル・テストにより 1000V ESD 定格に分類さ れています。ただし、ESD にさらされるとデバイス パラメト リック性能が低下する可能性があるため、このデバイスを 取り扱う際には注意を払う必要があります。
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技術資料

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* データシート TLV2352、デュアル、低電圧差動コンパレータ データシート (Rev. D 翻訳版) PDF | HTML 英語版 (Rev.D) PDF | HTML 2025年 7月 22日
e-Book（PDF） The Signal - オペアンプ設計ブログ集 英語版 2018年 3月 23日

設計と開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

評価ボード

AMP-PDK-EVM — アンプ パフォーマンス開発キットの評価基板

このアンプ パフォーマンス開発キット (PDK) は、オペアンプの一般的なパラメータをテストするための評価基板 (EVM) キットであり、ほとんどのオペアンプやコンパレータと互換性があります。この評価基板キットは、パッケージのニーズに適した、さまざまなソケット付きドーターカード オプションを搭載したメイン ボードで構成されており、エンジニアはデバイスの性能を迅速に評価および検証できます。

AMP-PDK-EVM キットは、業界標準の最も一般的な次の 5 種類のパッケージをサポートしています。

  • D (SOIC-8 と SOIC-14)
  • PW (TSSOP-14)
  • DGK (VSSOP-8)
  • (...)
ユーザー ガイド: PDF | HTML
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シミュレーション・モデル

TLV2352 PSpice Model

SLCJ030.ZIP (1 KB) - PSpice Model
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シミュレーション・ツール

PSPICE-FOR-TI — TI Design / シミュレーション ツール向け PSpice®

PSpice® for TI は、各種アナログ回路の機能評価に役立つ、設計とシミュレーション向けの環境です。設計とシミュレーションに適したこのフル機能スイートは、Cadence® のアナログ分析エンジンを使用しています。PSpice for TI は無償で使用でき、アナログや電源に関する TI の製品ラインアップを対象とする、業界でも有数の大規模なモデル ライブラリが付属しているほか、選択された一部のアナログ動作モデルも利用できます。

設計とシミュレーション向けの環境である PSpice for TI を使用すると、内蔵のライブラリを使用して、複雑なミックスド (...)
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シミュレーション・ツール

TINA-TI — SPICE ベースのアナログ・シミュレーション・プログラム

TINA-TI は、DC 解析、過渡解析、周波数ドメイン解析など、SPICE の標準的な機能すべてを搭載しています。TINA には多彩な後処理機能があり、結果を必要なフォーマットにすることができます。仮想計測機能を使用すると、入力波形を選択し、回路ノードの電圧や波形を仮想的に測定することができます。TINA の回路キャプチャ機能は非常に直観的であり、「クイックスタート」を実現できます。

TINA-TI をインストールするには、約 500MB が必要です。インストールは簡単です。必要に応じてアンインストールも可能です。(そのようなことはないと思いますが)

TINA は DesignSoft (...)

ユーザー ガイド: PDF
英語版 (Rev.A): PDF
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パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
PDIP (P) 8 Ultra Librarian
SOIC (D) 8 Ultra Librarian
TSSOP (PW) 8 Ultra Librarian
TI の評価基板に関する標準契約約款が適用されます。

購入と品質

記載されている情報：
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 使用材料
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報：
  • ファブ拠点
  • アセンブリ拠点

推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。

サポートとトレーニング

TI E2E™ フォーラムでは、TI のエンジニアからの技術サポートを提供

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コンテンツは、TI 投稿者やコミュニティ投稿者によって「現状のまま」提供されるもので、TI による仕様の追加を意図するものではありません。使用条件をご確認ください。

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