ADS61B29
- 集成式高阻抗模拟输入缓冲器
- 最大采样率:250MSPS
- 14 位分辨率 — ADS61B49
- 12 位分辨率 — ADS61B29
- 250MSPS 时的总功率耗散为 790mW
- 双倍数据速率 (DDR) LVDS 和并行 CMOS 输出选项
- 高达 6dB 的可编程精细增益支持 SNR/SFDR 权衡和 1Vpp 满量程运行
- 直流偏移校正
- 支持低至400mVPP 差分的输入时钟幅度
- 48-QFN 封装 (7mm × 7mm)
- 引脚与 ADS6149 系列兼容
ADS61B49 (ADS61B29) 是采样速率高达 250MSPS 的 14 位(12 位)模数转换器。它在紧凑的 48-QFN 封装中实现了高动态性能与低功耗的结合。集成式模拟缓冲器使其非常适合多载波、大带宽通信应用。缓冲器可在宽频率范围内保持恒定的性能和输入阻抗。
ADS61B49 (ADS61B29) 具有精细增益选项,可用于在较低满量程输入范围时提升 SFDR 性能。它包含一个可用于消除 ADC 偏移的直流偏移校正环路。可提供双倍数据速率 (DDR) LVDS 和并行 CMOS 数字输出接口。在较低的采样速率下,ADC 会自动以按比例降低的功率运行,而不会影响性能。
它包括内部基准,同时省去了传统基准引脚及相关去耦电容器。该器件在额定工业温度范围(–40°C 至 85°C)内符合规格要求。
技术文档
| 顶层文档 | 类型 | 标题 | 格式选项 | 下载最新的英语版本 | 日期 | |
|---|---|---|---|---|---|---|
| * | 数据表 | ADS61Bx9 具有集成模拟缓冲器的 14 位/12 位、250MSPS ADC 数据表 (Rev. C) | PDF | HTML | 2026年 6月 9日 | ||
| 应用手册 | Design Considerations for Avoiding Timing Errors during High-Speed ADC, LVDS Dat (Rev. A) | 2015年 5月 22日 | ||||
| 应用手册 | Why Use Oversampling when Undersampling Can Do the Job? (Rev. A) | 2013年 7月 19日 | ||||
| 应用手册 | Driving High-Speed ADCs: Circuit Topologies and System-Level Parameters (Rev. A) | 2010年 9月 10日 | ||||
| 应用手册 | Smart Selection of ADC/DAC Enables Better Design of Software-Defined Radio | 2009年 4月 28日 | ||||
| 应用手册 | 所选封装材料的热学和电学性质 | 2008年 10月 16日 | ||||
| 应用手册 | 模数规格和性能特性术语表 (Rev. A) | 最新英语版本 (Rev.B) | 2008年 10月 16日 | |||
| 应用手册 | 高速数据转换 | 英语版 | 2008年 10月 16日 | |||
| 应用手册 | CDCE62005 as Clock Solution for High-Speed ADCs | 2008年 9月 4日 | ||||
| 应用手册 | CDCE72010 as a Clocking Solution for High-Speed Analog-to-Digital Converters | 2008年 6月 8日 | ||||
| 应用手册 | Phase Noise Performance and Jitter Cleaning Ability of CDCE72010 | 2008年 6月 2日 | ||||
| 应用手册 | QFN Layout Guidelines | 2006年 7月 28日 |
设计与开发
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