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LMK05318B-Q1

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汽车级超低抖动网络同步器和时钟发生器

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产品详情

Function Clock network synchronizer Number of outputs 8 Output type CML, HCSL, LVCMOS, LVDS, LVPECL RMS jitter (fs) 50 Features I2C, Integrated EEPROM, Pin programmable, SPI Output frequency (min) (MHz) 0.000001 Output frequency (max) (MHz) 800 Input type LVCMOS, LVDS, LVPECL, XTAL Supply voltage (min) (V) 3.135 Supply voltage (max) (V) 3.465 Operating temperature range (°C) -40 to 125 Number of input channels 2
Function Clock network synchronizer Number of outputs 8 Output type CML, HCSL, LVCMOS, LVDS, LVPECL RMS jitter (fs) 50 Features I2C, Integrated EEPROM, Pin programmable, SPI Output frequency (min) (MHz) 0.000001 Output frequency (max) (MHz) 800 Input type LVCMOS, LVDS, LVPECL, XTAL Supply voltage (min) (V) 3.135 Supply voltage (max) (V) 3.465 Operating temperature range (°C) -40 to 125 Number of input channels 2
VQFN (RGZ) 48 49 mm² 7 x 7
  • 符合面向汽车应用的 AEC-Q100 标准
    • 工作温度范围：-40°C 至 105°C（2 级）
  • 基于 BAW VCO 的超低抖动以太网时钟
    • 使用 4MHz 一阶高通滤波器 (HPF) 时在 312.5MHz 下的典型 RMS 抖动为 32fs
    • 使用 4MHz 一阶 HPF 时在 156.25MHz 下的典型 RMS 抖动为 44fs
    • 在 312.5MHz 下典型 RMS 抖动为 50fs，最大 RMS 抖动为 80fs
    • 在 156.25MHz 下典型 RMS 抖动为 60fs，最大 RMS 抖动为 90fs
  • 将一个高性能数字锁相环 (DPLL) 与两个模拟锁相环 (APLL) 配对：
    • 1mHz 至 4kHz 可编程 DPLL 环路带宽
    • 进行每步小于 1ppt 的 DCO 频率调整，以完成 IEEE 1588 PTP 时钟控制
  • 两个差分或单端 DPLL 输入
    • 1Hz (1PPS) 至 800MHz 输入频率
    • 数字保持和无中断切换
  • 八个采用可编程 AC-LVPECL、AC-CML、AC-LVDS、HSCL 和 1.8V LVCMOS 输出格式的差分输出。
    • 1Hz (1PPS) 至 1250MHz 输出频率
    • 符合 PCIe 第 1 代到第 6 代标准
  • I2C 三线制 SPI 或四线制 SPI
  • 3.3V 核心电源和 1.8V、2.5V 或 3.3V 输出电源
  • 工作温度范围：-40°C 至 +105°C
  • 符合面向汽车应用的 AEC-Q100 标准
    • 工作温度范围：-40°C 至 105°C（2 级）
  • 基于 BAW VCO 的超低抖动以太网时钟
    • 使用 4MHz 一阶高通滤波器 (HPF) 时在 312.5MHz 下的典型 RMS 抖动为 32fs
    • 使用 4MHz 一阶 HPF 时在 156.25MHz 下的典型 RMS 抖动为 44fs
    • 在 312.5MHz 下典型 RMS 抖动为 50fs，最大 RMS 抖动为 80fs
    • 在 156.25MHz 下典型 RMS 抖动为 60fs，最大 RMS 抖动为 90fs
  • 将一个高性能数字锁相环 (DPLL) 与两个模拟锁相环 (APLL) 配对：
    • 1mHz 至 4kHz 可编程 DPLL 环路带宽
    • 进行每步小于 1ppt 的 DCO 频率调整，以完成 IEEE 1588 PTP 时钟控制
  • 两个差分或单端 DPLL 输入
    • 1Hz (1PPS) 至 800MHz 输入频率
    • 数字保持和无中断切换
  • 八个采用可编程 AC-LVPECL、AC-CML、AC-LVDS、HSCL 和 1.8V LVCMOS 输出格式的差分输出。
    • 1Hz (1PPS) 至 1250MHz 输出频率
    • 符合 PCIe 第 1 代到第 6 代标准
  • I2C 三线制 SPI 或四线制 SPI
  • 3.3V 核心电源和 1.8V、2.5V 或 3.3V 输出电源
  • 工作温度范围：-40°C 至 +105°C

LMK05318B-Q1 是一款高性能网络同步器和抖动清除器，旨在满足基于以太网的网络应用的严格要求。

该器件集成了一个 DPLL 和两个 APLL，可通过可编程环路带宽 (LBW) 提供无中断切换和抖动衰减功能，LBW 具有一个外部环路滤波电容器，可充分提升灵活性和易用性。

APLL1 具有超高性能 PLL，在 VCO1 中采用 TI 专有体声波 (BAW) 技术，可在 312.5MHz 频率下生成具有 50fs（典型值）的 RMS 抖动（12kHz 至 20MHz）的输出时钟，而不受 DPLL 基准输入的频率和抖动特性的影响。APLL2 采用传统的 LC VCO，可提供用于第二频率域和/或同步域的选项。

集成的 EEPROM 可用于在启动时定义系统配置。内部 LDO 稳压器可提供出色的电源噪声抑制 (PSNR)，从而降低了电源分配网络的成本和复杂性。

LMK05318B-Q1 是一款高性能网络同步器和抖动清除器，旨在满足基于以太网的网络应用的严格要求。

该器件集成了一个 DPLL 和两个 APLL，可通过可编程环路带宽 (LBW) 提供无中断切换和抖动衰减功能，LBW 具有一个外部环路滤波电容器，可充分提升灵活性和易用性。

APLL1 具有超高性能 PLL，在 VCO1 中采用 TI 专有体声波 (BAW) 技术，可在 312.5MHz 频率下生成具有 50fs（典型值）的 RMS 抖动（12kHz 至 20MHz）的输出时钟，而不受 DPLL 基准输入的频率和抖动特性的影响。APLL2 采用传统的 LC VCO，可提供用于第二频率域和/或同步域的选项。

集成的 EEPROM 可用于在启动时定义系统配置。内部 LDO 稳压器可提供出色的电源噪声抑制 (PSNR)，从而降低了电源分配网络的成本和复杂性。
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* 数据表 LMK05318B-Q1 是一款集成了 1 个 DPLL 和 2 个 APLL，支持 2 路输入和 8 路输出 的网络同步器，采用 BAW VCO 技术，适用于 汽车和工业 应用 数据表 (Rev. A) PDF | HTML 英语版 (Rev.A) PDF | HTML 2025年 12月 23日

设计与开发

如需其他信息或资源，请点击以下任一标题进入详情页面查看（如有）。

评估板

LMK05318BEVM — 网络同步器时钟评估模块

这是一款适用于 LMK05318B 网络同步器时钟器件的评估模块 (EVM)。
EVM 可以用作灵活的同步时钟源，用于快速评估、合规性测试和系统原型设计。SMA 端口可用于访问 LMK05318B 时钟输入和输出，以便连接到 50Ω 测试设备。该评估模块包含板载 XO 选项，但可采用各种 XO/TCXO/OCXO 封装对这些选项进行重新设计，或对其设置旁路以便使用外部 SMA 输入。EVM 提供一个基于 USB 的接口来访问 LMK05318B 的 I2C/SPI 总线和控制引脚。可使用 TICS PRO 软件 GUI 对 LMK05318B 的寄存器和 EEPROM (...)

用户指南: PDF
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设计工具

CLOCK-TREE-ARCHITECT — 时钟树架构编程软件

时钟树架构是一款时钟树综合工具，可根据您的系统要求生成时钟树解决方案，从而帮助您简化设计流程。该工具从庞大的时钟产品数据库中提取数据，然后生成系统级多芯片时钟解决方案。
立即设计
设计工具

PLLATINUMSIM-SW — PLLatinum Sim Tool

PLLATINUMSIM-SW is a simulation tool that allows users to create detailed designs and simulations of our PLLatinum™ integrated circuits, which include the LMX series of phase-locked loops (PLLs) and synthesizers.

支持的产品和硬件

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模拟工具

PSPICE-FOR-TI — PSpice® for TI 设计和仿真工具

PSpice® for TI 可提供帮助评估模拟电路功能的设计和仿真环境。此功能齐全的设计和仿真套件使用 Cadence® 的模拟分析引擎。PSpice for TI 可免费使用，包括业内超大的模型库之一，涵盖我们的模拟和电源产品系列以及精选的模拟行为模型。

借助 PSpice for TI 的设计和仿真环境及其内置的模型库，您可对复杂的混合信号设计进行仿真。创建完整的终端设备设计和原型解决方案，然后再进行布局和制造，可缩短产品上市时间并降低开发成本。 

在 PSpice for TI 设计和仿真工具中，您可以搜索 TI (...)
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封装 引脚 CAD 符号、封装和 3D 模型
VQFN (RGZ) 48 Ultra Librarian
适用于评估类项目的 TI 标准条款与条件。

订购和质量

包含信息：
  • RoHS
  • REACH
  • 器件标识
  • 引脚镀层/焊球材料
  • MSL 等级/回流焊峰值温度
  • MTBF/时基故障估算
  • 材料成分
  • 鉴定摘要
  • 持续可靠性监测
包含信息：
  • 制造厂地点
  • 封装厂地点

推荐产品可能包含与 TI 此产品相关的参数、评估模块或参考设计。

支持和培训

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