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TSER4905

アクティブ

高解像度パネル向け、4K DSI から V³Link™ へのシリアライザ

製品詳細

Applications Display SerDes Color depth (bpp) 30 Function Serializer Input compatibility DSI Pixel clock frequency (max) (MHz) 1110 Output compatibility V3Link Features CRC, Coax or STP, Flexible GPIOs, I2C Config, Line Fault Detection, Pattern Generation, Ultra-Low Data and Control Path Latency Signal conditioning Adaptive Equalizer EMI reduction LVDS Diagnostics BIST Rating Catalog Operating temperature range (°C) -20 to 85
Applications Display SerDes Color depth (bpp) 30 Function Serializer Input compatibility DSI Pixel clock frequency (max) (MHz) 1110 Output compatibility V3Link Features CRC, Coax or STP, Flexible GPIOs, I2C Config, Line Fault Detection, Pattern Generation, Ultra-Low Data and Control Path Latency Signal conditioning Adaptive Equalizer EMI reduction LVDS Diagnostics BIST Rating Catalog Operating temperature range (°C) -20 to 85
VQFNP (RTD) 64 81 mm² 9 x 9
  • シングル・ポートまたはデュアル・ポートの MIPI DSI レシーバ
    • D-PHY v1.2 および DSI v1.3.1 に準拠
    • パック形式の 16/18/24/30 ビット RGB および 16 ビット YCbCr
    • ルーズ・パック形式の 18 ビット RGB と 20 ビット 4:2:2
    • D-PHY ポートごとに 1 つのクロック・レーンと 1~4 の構成可能なデータ・レーン
    • 最大 2.5Gbps / レーン、 スキュー較正付き
    • データ・レーンのスワップと極性反転をサポート
    • バースト・モードと非バースト・モードの両方をサポート
    • SuperFrame 開梱機能
    • 4K @ 60Hz のビデオ解像度に最適
  • V 3Link 拡張ビデオ・インターフェイス
    • チャネルあたり 10.8/6.75/3.375Gbps をサポート、デュアル・チャネルで最大 21.6Gbps をサポート
    • 同軸 / STP 相互接続サポート
    • ポート分割により Y 字型ケーブル・インターフェイスを実現
  • 超低レイテンシ制御チャネル
    • 最大 1MHz の 2 つの I2C (ローカル・バス・アクセス用に最大 3.4MHz)
    • 高速 GPIO
  • HDCP v1.4 サポートを含む 互換性
    • V 3Link ビデオおよび V 3Link 拡張ビデオ製品ファミリ
    • V 3Link Vision 製品ファミリ
  • セキュリティと診断
    • 電圧および電流の監視
    • ライン・フォルト検出
    • BIST およびパターン生成
    • CRC およびエラー診断
    • 偽造防止向けの一意の ID
    • ECC ON 制御ビット
  • 高度なリンク堅牢性と EMC 制御
    • データ・スクランブル
    • スペクトラム拡散クロック生成 (SSCG)
  • 低消費電力動作
    • 1.8V と 1.1V のデュアル電源
  • 認定
    • ISO 10605 および IEC 61000-4-2 ESD に準拠
    • 64 ピン QFN ウェッタブル・フランク (9mm × 9mm)
    • 温度範囲:-20℃~+85℃
  • シングル・ポートまたはデュアル・ポートの MIPI DSI レシーバ
    • D-PHY v1.2 および DSI v1.3.1 に準拠
    • パック形式の 16/18/24/30 ビット RGB および 16 ビット YCbCr
    • ルーズ・パック形式の 18 ビット RGB と 20 ビット 4:2:2
    • D-PHY ポートごとに 1 つのクロック・レーンと 1~4 の構成可能なデータ・レーン
    • 最大 2.5Gbps / レーン、 スキュー較正付き
    • データ・レーンのスワップと極性反転をサポート
    • バースト・モードと非バースト・モードの両方をサポート
    • SuperFrame 開梱機能
    • 4K @ 60Hz のビデオ解像度に最適
  • V 3Link 拡張ビデオ・インターフェイス
    • チャネルあたり 10.8/6.75/3.375Gbps をサポート、デュアル・チャネルで最大 21.6Gbps をサポート
    • 同軸 / STP 相互接続サポート
    • ポート分割により Y 字型ケーブル・インターフェイスを実現
  • 超低レイテンシ制御チャネル
    • 最大 1MHz の 2 つの I2C (ローカル・バス・アクセス用に最大 3.4MHz)
    • 高速 GPIO
  • HDCP v1.4 サポートを含む 互換性
    • V 3Link ビデオおよび V 3Link 拡張ビデオ製品ファミリ
    • V 3Link Vision 製品ファミリ
  • セキュリティと診断
    • 電圧および電流の監視
    • ライン・フォルト検出
    • BIST およびパターン生成
    • CRC およびエラー診断
    • 偽造防止向けの一意の ID
    • ECC ON 制御ビット
  • 高度なリンク堅牢性と EMC 制御
    • データ・スクランブル
    • スペクトラム拡散クロック生成 (SSCG)
  • 低消費電力動作
    • 1.8V と 1.1V のデュアル電源
  • 認定
    • ISO 10605 および IEC 61000-4-2 ESD に準拠
    • 64 ピン QFN ウェッタブル・フランク (9mm × 9mm)
    • 温度範囲:-20℃~+85℃

TSER4905 は MIPI DSI から V 3Link へのブリッジ・デバイスです。 V 3Link デシリアライザと組み合わせることで、このチップセットは低コストの 50Ω 同軸ケーブルまたは STP ケーブルで高速のシリアル化インターフェイスを提供します。 TSER4905 は、30 ビット色深度で 4K を含むビデオ解像度をサポートする MIPI DSI 入力をシリアライズする D-PHY v1.2 準拠デバイスです。 V 3Link インターフェイスは、ビデオおよびオーディオ・データの伝送に加えて、シングル・チャネルまたはデュアル・チャネルで、I2C および GPIO データなどの全二重制御をサポートします。ビデオ・データと制御を 2 つの V 3Link レーンに統合することで、相互接続のサイズと重量が減少し、システムの設計が簡素化されます。低電圧の差動信号、データのスクランブル処理、SSCG、およびランダム化を使用することで、EMI が最小限に抑えられます。 このデバイスは、V 3Link モードと V 3Link 拡張ビデオ・モードのどちらかで動作できます。V 3Link 拡張ビデオ・モードでは、このデバイスは最大 10.8Gbps のライン・レートで動作する単一の同軸 /STP ケーブルまたは最大 21.6Gbps のライン・レートで動作するデュアル同軸 /STP ケーブルによる V 3Link 拡張ビデオ出力をサポートし、4K 以上の解像度をサポートします。 V 3Link モードでは、このデバイスはシングル / デュアル・リンクで最大 720p および 1080p の解像度をサポートし,。 Vision 互換モードでは、このデバイスは最大 8MP+/40fps の解像度をサポートする V 3Link Vision デシリアライザと相互運用可能です。

TSER4905 は MIPI DSI から V 3Link へのブリッジ・デバイスです。 V 3Link デシリアライザと組み合わせることで、このチップセットは低コストの 50Ω 同軸ケーブルまたは STP ケーブルで高速のシリアル化インターフェイスを提供します。 TSER4905 は、30 ビット色深度で 4K を含むビデオ解像度をサポートする MIPI DSI 入力をシリアライズする D-PHY v1.2 準拠デバイスです。 V 3Link インターフェイスは、ビデオおよびオーディオ・データの伝送に加えて、シングル・チャネルまたはデュアル・チャネルで、I2C および GPIO データなどの全二重制御をサポートします。ビデオ・データと制御を 2 つの V 3Link レーンに統合することで、相互接続のサイズと重量が減少し、システムの設計が簡素化されます。低電圧の差動信号、データのスクランブル処理、SSCG、およびランダム化を使用することで、EMI が最小限に抑えられます。 このデバイスは、V 3Link モードと V 3Link 拡張ビデオ・モードのどちらかで動作できます。V 3Link 拡張ビデオ・モードでは、このデバイスは最大 10.8Gbps のライン・レートで動作する単一の同軸 /STP ケーブルまたは最大 21.6Gbps のライン・レートで動作するデュアル同軸 /STP ケーブルによる V 3Link 拡張ビデオ出力をサポートし、4K 以上の解像度をサポートします。 V 3Link モードでは、このデバイスはシングル / デュアル・リンクで最大 720p および 1080p の解像度をサポートし,。 Vision 互換モードでは、このデバイスは最大 8MP+/40fps の解像度をサポートする V 3Link Vision デシリアライザと相互運用可能です。

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技術資料

star =TI が選定したこの製品の主要ドキュメント
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上位の文書 タイプ タイトル フォーマットオプション 最新の英語版をダウンロード 日付
* データシート TSER49054KDSI からV3Linkブリッジ・シリアライザ、 データシート PDF | HTML 英語版 PDF | HTML 2023年 7月 5日
証明書 TSER4905EVM EU RoHS Declaration of Conformity (DoC) 2022年 9月 15日

設計と開発

その他のアイテムや必要なリソースを参照するには、以下のタイトルをクリックして詳細ページをご覧ください。

アプリケーション・ソフトウェアとフレームワーク

ALP Analog LaunchPad Framework Utility

Analog LaunchPad (ALP) software is an interactive graphical user interface (GUI) software platform to evaluate TI FPD-Link™ serializers and deserializers (SerDes). ALP software enables device- and system-level evaluation with powerful built-in features, including:

  • Local and remote device access
  • (...)
サポート対象の製品とハードウェア

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サポート・ソフトウェア

ALP-PROFILE-UPDATE Analog LaunchPad Profile Update Software

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サポート対象の製品とハードウェア

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シミュレーション・ツール

PSPICE-FOR-TI — TI Design / シミュレーション ツール向け PSpice®

PSpice® for TI は、各種アナログ回路の機能評価に役立つ、設計とシミュレーション向けの環境です。設計とシミュレーションに適したこのフル機能スイートは、Cadence® のアナログ分析エンジンを使用しています。PSpice for TI は無償で使用でき、アナログや電源に関する TI の製品ラインアップを対象とする、業界でも有数の大規模なモデル ライブラリが付属しているほか、選択された一部のアナログ動作モデルも利用できます。

設計とシミュレーション向けの環境である PSpice for TI を使用すると、内蔵のライブラリを使用して、複雑なミックスド (...)
シミュレーション・ツール

TINA-TI — SPICE ベースのアナログ・シミュレーション・プログラム

TINA-TI は、DC 解析、過渡解析、周波数ドメイン解析など、SPICE の標準的な機能すべてを搭載しています。TINA には多彩な後処理機能があり、結果を必要なフォーマットにすることができます。仮想計測機能を使用すると、入力波形を選択し、回路ノードの電圧や波形を仮想的に測定することができます。TINA の回路キャプチャ機能は非常に直観的であり、「クイックスタート」を実現できます。

TINA-TI をインストールするには、約 500MB が必要です。インストールは簡単です。必要に応じてアンインストールも可能です。(そのようなことはないと思いますが)

TINA は DesignSoft (...)

ユーザー ガイド: PDF
英語版 (Rev.A): PDF
パッケージ ピン数 CAD シンボル、フットプリント、および 3D モデル
VQFNP (RTD) 64 Ultra Librarian

購入と品質

記載されている情報:
  • RoHS
  • REACH
  • デバイスのマーキング
  • リード端子の仕上げ / ボールの原材料
  • MSL 定格 / ピーク リフロー
  • MTBF/FIT 推定値
  • 使用材料
  • 認定試験結果
  • 継続的な信頼性モニタ試験結果
記載されている情報:
  • ファブ拠点
  • アセンブリ拠点

推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。

サポートとトレーニング

TI E2E™ フォーラムでは、TI のエンジニアからの技術サポートを提供

コンテンツは、TI 投稿者やコミュニティ投稿者によって「現状のまま」提供されるもので、TI による仕様の追加を意図するものではありません。使用条件をご確認ください。

TI 製品の品質、パッケージ、ご注文に関するお問い合わせは、TI サポートをご覧ください。​​​​​​​​​​​​​​

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