DRA821U-Q1
ネットワークとコンピューティング向け、デュアル Arm®Cortex®-A72 と 4 ポートのイーサネットと 4 レーンの PCIe を搭載した SoC
DRA821U-Q1
プロセッサ・コア:
- デュアル 64 ビット Arm Cortex-A72 イクロプロセッサ・サブシステム、最大 2.0GHz、24K DMIPS
- デュアル・コア Cortex-A72 クラスタごとに 1MB L2 共有キャッシュ
- A72 ごとに 32KB L1 D キャッシュと 48KB L1 I キャッシュ
- 4 つの Arm Cortex-R5F マイコン、最大 1.0GHz で動作、オプションのロックステップ動作、8K DMIPS
- 32K I キャッシュ、32K D キャッシュ、64K L2 TCM
- 分離マイコン・サブシステムに 2 つの Arm Cortex-R5F マイコン
- 汎用コンピューティング・パーティションに 2 つの Arm Cortex-R5F マイコン
メモリ・サブシステム:
- 1MB のオンチップ L3 RAM、ECC およびコヒーレンシ機能付き
- ECC エラー保護
- 共有コヒーレント・キャッシュ
- 内部 DMA エンジンをサポート
- ECC 付きの外部メモリ・インターフェイス (EMIF) モジュール
- JESD209-4B 仕様に準拠した LPDDR4 メモリ・タイプをサポートしています。(バイト・モード LPDDR4 メモリ、または 17 行を超えるアドレス・ビットを持つメモリはサポートしていません)
- 最高 3200MT/s の速度をサポート
- インライン ECC 付きで最高 12.8GB/s の 32 ビットおよび 16 ビット・データ・バス
- 汎用メモリ・コントローラ (GPMC)
- メイン・ドメインの 512KB のオンチップ SRAM、ECC 保護付き
仮想化:
- Arm Cortex-A72 のハイパーバイザ・サポート
- 独立した処理サブシステム、Arm Cortex-A72、Arm Cortex-R5F、分離セーフティ・マイコン・アイランド付き
- IO 仮想化のサポート
- 低レイテンシ広帯域幅ペリフェラル・トラフィック用のペリフェラル仮想化ユニット (PVU)
- メモリとペリフェラルの分離を目的としたマルチ領域ファイアウォールのサポート
- イーサネット、PCIe、DMA による仮想化サポート
-
デバイスのセキュリティ (一部の部品番号のみ):
- セキュアなランタイム・サポートによるセキュア・ブート
- お客様がプログラム可能なルート・キー (RSA-4K または ECC-512 まで)
- 組み込みハードウェア・セキュリティ・モジュール
- 暗号化ハードウェア・アクセラレータ – ECC 付き PKA、AES、SHA、RNG、DES、3DES
機能安全:
- 機能安全準拠製品向け (一部の部品番号でのみ対応)
- 機能安全アプリケーション向けに開発
- ASIL-D/SIL-3 までを対象とした ISO 26262 および IEC 61508 機能安全システム設計を支援するための資料を提供予定
- 決定論的対応能力、ASIL-D/SIL-3 までを対象
- ハードウェア整合性、MCU ドメイン向け ASIL-D/SIL-3 までを対象
- ハードウェア整合性、メイン・ドメインの拡張 MCU (EMCU) 部分向け ASIL-D/SIL-3 までを対象
- ハードウェア整合性、メイン・ドメインの残りの部分向け ASIL-B/SIL-2 までを対象
- メイン・ドメインの残りの部分と EMCU との間に設けられた FFI 分離
- 安全関連の認証
- による ISO 26262 および IEC 61508 認証を計画中
- 部品番号の末尾が Q1 のバリアントについては AEC-Q100 認定済み
-
高速インターフェイス:
- 最大 4 つ (DRA821U4) または 2 つ (DRA821U2) の外部ポートをサポートする統合型イーサネット TSN/AVB スイッチ:
- 1 つのポートが 5Gb、10Gb USXGMII/XFI をサポート
- すべてのポートが 2.5Gb SGMII をサポート
- すべてのポートが 1Gb SGMII/RGMII をサポート
- DRA821U4:任意のシングル・ポートが QSGMII をサポート可能 (4 つの内部ポートのすべてを使用)
- ノン・ブロッキング・ワイヤ・レート・ストア・アンド・フォワード・スイッチ
- VLAN 間 (レイヤ 3) ルーティングのサポート
- IEEE 1588 による時間同期のサポート (Annex D、E、F)
- トラフィック・スケジューリングおよびシェーピング用の TSN/AVB サポート
- デバッグおよび診断用のポート・ミラーリング機能
- ポリシングおよびレート制限のサポート
- セーフティ・マイコン・アイランドに 1 つの RGMII/RMII ポート
- 最大 4 つ (DRA821U4) または 2 つ (DRA821U2) の外部ポートをサポートする統合型イーサネット TSN/AVB スイッチ:
- 1 つの PCI-Express Gen3 コントローラ
- オートネゴシエーションを使用した Gen 1、Gen 2、Gen 3 の動作
- 4 レーン
- 1 つの USB 3.1 Gen1 デュアルロール・デバイス・サブシステム
- Type-C スイッチングをサポート
- 個別に USB ホスト、USB ペリフェラル、USB デュアルロール・デバイスとして構成可能
車載インターフェイス:
- 20 個の CAN-FD ポート
- 12 個の UART (Universal Asynchronous Receivers/Transmitter)
- 11 個のシリアル・ペリフェラル・インターフェイス (SPI)
- 1 つの 8 チャネル ADC
- 10 個の I2C™ (Inter-Integrated Circuit)
- 2 つの I3C (Improved Inter-Integrated Circuit)
オーディオ・インターフェイス:
- 3 つのマルチチャネル・オーディオ・シリアル・ポート (McASP) モジュール
フラッシュ・メモリ・インターフェイス:
- eMMC™ 5.1 (Embedded Multi-Media Card) インターフェイス
- 最大 HS400 の速度をサポート
- 1 つの Secure Digital 3.0/Secure Digital Input Output 3.0 (SD3.0/SDIO3.0) インターフェイス
- 1 つの Octal SPI/Xccela™/HyperBus™ メモリ・コントローラ (HBMC) インターフェイス
- 16nm FinFET テクノロジ
- 17.2mm × 17.2mm、0.8mm ピッチ、IPC Class 3 PCB
Jacinto™ DRA821x プロセッサは、Armv8 64 ビット・アーキテクチャをベースとし、クラウド接続を使用するゲートウェイ・システム向けに最適化されています。システム・オン・チップ (SoC) 設計により、特にシステム・マイコン、機能安全とセキュリティ機能、高速通信用のイーサネット・スイッチなどの統合によって、システム・レベルのコストと複雑さを低減できます。統合型の診断機能と安全機能は、ASIL-D および SIL3 認証要件を対象としています。PCIe コントローラと TSN 対応のギガビット・イーサネット・スイッチにより、リアルタイム制御と低レイテンシ通信が可能になります。
最大 4 つの汎用 Arm® Cortex®-R5F サブシステムにより、ローレベルのタイミング重視の処理タスクを処理でき、Arm® Cortex®-A72 コアを高度なクラウド・ベースのアプリケーションに使用できます。
Jacinto DRA821x プロセッサは、拡張 MCU (eMCU) ドメインのコンセプトも採用しています。このドメインは、ASIL-D/SIL-3 などの高度な機能安全性の実現を目的としたメイン・ドメインのプロセッサとペリフェラルのサブセットです。機能ブロック図では、eMCU に属する IP を強調して示しています。eMCU と機能安全性の詳細については、 『テキサス・インスツルメンツ Jacinto™ 7 製品ファミリの DRA821 安全マニュアル (SPRUIX4)』を参照してください。
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技術資料
設計および開発
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サポート対象の製品とハードウェア
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C2000 リアルタイム マイコン
Wi-Fi 製品
産業用ミリ波レーダー センサ
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Arm Cortex-M0+ マイコン
Arm Cortex-R マイコン
Sub-1GHz ワイヤレス マイコン
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| パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
|---|---|---|
| FCBGA (ALM) | 433 | Ultra Librarian |
購入と品質
- RoHS
- REACH
- デバイスのマーキング
- リード端子の仕上げ / ボールの原材料
- MSL 定格 / ピーク リフロー
- MTBF/FIT 推定値
- 使用原材料
- 認定試験結果
- 継続的な信頼性モニタ試験結果
- ファブの拠点
- 組み立てを実施した拠点
推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。