ソフトウェア・プログラミング・ツール
LMK03328
- 超低ノイズ、高性能
- ジッタ：100fs RMS (標準値)、FOUT > 100MHz
- PSNR：-80dBc、堅牢な電源ノイズ耐性
- 柔軟なデバイス オプション
- 最大 8 つの AC-LVPECL、AC-LVDS、AC-CML、HCSL、LVCMOS 出力を任意の組み合わせで使用可能
- ピン モード、I2C モード、EEPROM モード
- 71 ピンで選択可能なプログラム済みのデフォルト スタートアップ オプション
- 自動または手動の選択によるデュアル入力
- 水晶振動子入力：10MHz～52MHz
- 外部入力：1MHz～300MHz
- 周波数マージニング オプション
- 低コストのプル可能な水晶振動子を基準に使用した、きめ細かい周波数マージニング (標準値 ±50ppm)
- 出力分周器を使用した、グリッチレスな粗い周波数マージニング (%)
- その他の特長
- 電源電圧：3.3V コア、1.8V、2.5V、3.3V 出力
- 工業用温度範囲：-40℃～85℃
- パッケージ：7mm×7mm 48-WQFN
LMK03328 デバイスは超低ノイズのクロック ジェネレータであり、2 つのフラクショナル N 周波数シンセサイザと内蔵 VCO、柔軟なクロック分配およびファンアウトといった特長を備え、ピンで選択可能な構成状態がオンチップの EEPROM に格納されています。このデバイスは、各種の数ギガビット速度のシリアル インターフェイスおよびデジタル デバイス用に複数のクロックを生成できるため、BOM コストと基板面積を削減し、複数の発振器とクロック分配デバイスを置き換えることで信頼性を向上できます。超低ジッタにより、高速シリアル リンクにおけるビット エラー レート(BER)を低減します。
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技術資料
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|---|---|---|---|---|---|---|
| * | データシート | LMK03328 2 つの独立 PLL、8 出力、EEPROM 内蔵、超低ジッタのクロック ジェネレータ データシート (Rev. E 翻訳版) | PDF | HTML | 英語版 (Rev.E) | PDF | HTML | 2024年 10月 2日 |
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| 技術記事 | How to select an optimal clocking solution for your FPGA-based design | PDF | HTML | 2015年 12月 9日 |
設計と開発
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評価ボード
LMK03328EVM — LMK03328EVM 2 個の PLL、8 組の差動出力、2 個の入力を採用した超低ジッタ・クロック・ジェネレータの評価基板
LMK03328EVM 評価基板は、デュアル PLL、8 個の出力、2 個の入力、および内蔵 EEPROM を採用した超低ジッタ・クロック・ジェネレータである TI (テキサス・インスツルメンツ) の LMK03328 を搭載しており、100fs (フェムト秒) RMS のジッタ性能とピン構成モードおよびソフトウェア構成モードの評価に適した包括的なクロック供給プラットフォームを実現します。
LMK03328EVM は、準拠試験、性能評価、初期のシステム・プロトタイプ製作を行う際に、フレキシブルな複数出力のクロック供給源として使用できます。エッジ接続可能な複数の SMA (...)
ユーザー ガイド: PDF
サポート・ソフトウェア
TICSPRO-SW — TICS Pro GUI and Live Programming Tool for Clocking Devices
Texas Instruments clocks and synthesizers (TICS) pro software is used to program the evaluation modules (EVMs) for product numbers with these prefixes: CDC, LMK and LMX. These products include phase-locked loops and voltage-controlled oscillators (PLL+VCO), synthesizers and clocking devices.
サポート対象の製品とハードウェア
設計ツール
CLOCK-TREE-ARCHITECT — Clock tree architect プログラミング ソフトウェア
Clock tree architect はクロック ツリーの合成ツールであり、開発中システムの要件に基づいてクロック ツリー ソリューションを生成する方法で、お客様の設計プロセスの効率化に貢献します。このツールは、多様なクロック供給製品を収録した包括的なデータベースからデータを抽出し、システム レベルのマルチチップ クロック供給ソリューションを生成します。
設計ツール
PLLATINUMSIM-SW — PLL loop filter, phase noise, lock time, and spur simulation tool
PLLATINUMSIM-SW is a simulation tool that allows users to create detailed designs and simulations of our PLLatinum™ integrated circuits, which include the LMX series of phase-locked loops (PLLs) and synthesizers.
サポート対象の製品とハードウェア
シミュレーション・ツール
PSPICE-FOR-TI — TI Design / シミュレーション ツール向け PSpice®
PSpice® for TI は、各種アナログ回路の機能評価に役立つ、設計とシミュレーション向けの環境です。設計とシミュレーションに適したこのフル機能スイートは、Cadence® のアナログ分析エンジンを使用しています。PSpice for TI は無償で使用でき、アナログや電源に関する TI の製品ラインアップを対象とする、業界でも有数の大規模なモデル ライブラリが付属しているほか、選択された一部のアナログ動作モデルも利用できます。
設計とシミュレーション向けの環境である PSpice for TI を使用すると、内蔵のライブラリを使用して、複雑なミックスド (...)
設計とシミュレーション向けの環境である PSpice for TI を使用すると、内蔵のライブラリを使用して、複雑なミックスド (...)
| パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
|---|---|---|
| WQFN (RHS) | 48 | Ultra Librarian |
購入と品質
記載されている情報：
- RoHS
- REACH
- デバイスのマーキング
- リード端子の仕上げ / ボールの原材料
- MSL 定格 / ピーク リフロー
- MTBF/FIT 推定値
- 使用材料
- 認定試験結果
- 継続的な信頼性モニタ試験結果
記載されている情報：
- ファブ拠点
- アセンブリ拠点
推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。