評価基板 (EVM) 向けの GUI
データシート
ADS5295
- Maximum Sample Rate: 100 MSPS
- Designed for Low Power:
- 80 mW per channel at 100 MSPS
- SNR: 70.6 dBFS
- SFDR: 85 dBc at 10 MHz, 100 MSPS
- Serial LVDS ADC Data Outputs:
- One- or Two-Wire Serialized LVDS Outputs per Channel
- One-Wire Interface:
Up to 80 MSPS Sample Rate - Two-Wire Interface:
Up to 100 MSPS Sample Rate
- Digital Processing Block:
- Programmable FIR Decimation Filter and Oversampling to Minimize Harmonic Interference
- Programmable IIR High-Pass Filter to Minimize DC Offset
- Programmable Digital Gain: 0 dB to 12 dB
- Low-Frequency Noise Suppression Mode
- Programmable Mapping Between ADC Input Channels and LVDS Output Pins
- Channel Averaging Mode
- Variety of LVDS Test Patterns to Verify
Data Capture by FPGA or Receiver - Package: 12-mm × 12-mm QFP-80
The ADS5295 is a low-power, 12-bit, 100-MSPS, 8-channel analog-to-digital converter (ADC). Low power consumption and integration of multiple channels in a compact package make the device attractive for very high channel count data acquisition systems.
Serial low-voltage differential signaling (LVDS) outputs reduce the number of interface lines and enable high system integration. The ADC digital data can be output over one or two wires of LVDS pins per channel. At high sample rates, the two-wire interface helps keep the serial data rate low, allowing low-cost field-programmable gate array (FPGA)-based receivers to be used.
The device integrates an internal reference trimmed to accurately match across devices. Best performance is expected to be achieved through the internal reference mode. However, the device can be driven with external references as well.
Several digital functions that are commonly used in systems are included in the device. These functions include a low-frequency suppression mode, digital filtering options, and programmable mapping.
For low input frequency applications, the low-frequency noise suppression mode enables noise suppression at low frequencies and improves signal-to-noise ratio (SNR) in the 1-MHz band near dc by approximately 3 dB. Digital filtering options include low-pass, high-pass, and band-pass digital filters, as well as dc offset removal filters. The device also provides programmable mapping of the LVDS output pins and analog input channels. For applications where the 12-bit ADC SNR is not required, the ADS5295 can be configured as an 8-channel, 10-bit ADC with 10x LVDS serialization to reduce the output data rate.
The device is available in a 12-mm × 12-mm QFP-80 package. The ADS5295 is specified over the –40°C to +85°C operating temperature range.
技術資料
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9 をすべて表示 | 上位の文書 | タイプ | タイトル | フォーマットオプション | 最新の英語版をダウンロード | 日付 | |
|---|---|---|---|---|---|---|
| * | データシート | 12-Bit, 100-MSPS, 8-Channel Analog-to-Digital Converter データシート | 2012年 12月 10日 | |||
| アプリケーション・ノート | Design Considerations for Avoiding Timing Errors during High-Speed ADC, LVDS Dat (Rev. A) | 2015年 5月 22日 | ||||
| アプリケーション・ノート | Why Use Oversampling when Undersampling Can Do the Job? (Rev. A) | 2013年 7月 19日 | ||||
| アプリケーション・ノート | Understanding Serial LVDS Capture in High-Speed ADCs | 2013年 7月 10日 | ||||
| EVM ユーザー ガイド (英語) | ADS5295, 8-Channel ADC Evaluation Module | 2012年 4月 30日 | ||||
| アプリケーション・ノート | 高速データ変換 | 英語版 | 2009年 12月 11日 | |||
| アプリケーション・ノート | データ収集と A/D 変換の原理 | 最新英語版 (Rev.A) | PDF | HTML | 2009年 8月 5日 | ||
| アプリケーション・ノート | データ・コンバータのドリフトに関する設計者の必須知識: 最悪劣化度の構成要素を理解して仕様の条件を減らす | 2009年 4月 22日 | ||||
| アプリケーション・ノート | アナログ・デジタルの仕様とパフォーマンス特性の用語集 (Rev. A 翻訳版) | 最新英語版 (Rev.B) | 2008年 1月 18日 |
設計と開発
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| パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
|---|---|---|
| HTQFP (PFP) | 80 | Ultra Librarian |
購入と品質
記載されている情報：
- RoHS
- REACH
- デバイスのマーキング
- リード端子の仕上げ / ボールの原材料
- MSL 定格 / ピーク リフロー
- MTBF/FIT 推定値
- 使用材料
- 認定試験結果
- 継続的な信頼性モニタ試験結果
記載されている情報：
- ファブ拠点
- アセンブリ拠点
推奨製品には、この TI 製品に関連するパラメータ、評価基板、またはリファレンス デザインが存在する可能性があります。