The ADS61JB23 is a high-performance, low-power, single channel analog-to-digital converter with an integrated JESD204A output interface. Available in a 6 mm × 6 mm QFN package, with both single-lane and dual-lane output modes, the ADS61JB23 offers an unprecedented level of compactness. The output interface is compatible to the JESD204A standard, with an additional mode (as per IEEE Std 802.3-2002 part3, Clause 36.2.4.12) to interface seamlessly to the TI TLK family of SERDES transceivers. Equally impressive is the inclusion of an on-chip analog input buffer, providing isolation between the sample/hold switches and higher and more consistent input impedance.
The ADS61JB23 is specified over the industrial temperature range (–40°C to 85°C).
| 上位の文書 | タイプ | タイトル | フォーマットオプション | 最新の英語版をダウンロード | 日付 | |
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| * | データシート | 12-Bit Input-Buffered 80 MSPS ADC with JESD204A Output Interface データシート | 2012年 12月 1日 | |||
| アプリケーション・ノート | Design Considerations for Avoiding Timing Errors during High-Speed ADC, LVDS Dat (Rev. A) | 2015年 5月 22日 | ||||
| アプリケーション・ノート | Why Use Oversampling when Undersampling Can Do the Job? (Rev. A) | 2013年 7月 19日 | ||||
| アプリケーション・ノート | 高速データ変換 | 英語版 | 2009年 12月 11日 | |||
| アプリケーション・ノート | データ収集と A/D 変換の原理 | 最新英語版 (Rev.A) | PDF | HTML | 2009年 8月 5日 | ||
| アプリケーション・ノート | データ・コンバータのドリフトに関する設計者の必須知識: 最悪劣化度の構成要素を理解して仕様の条件を減らす | 2009年 4月 22日 | ||||
| アプリケーション・ノート | アナログ・デジタルの仕様とパフォーマンス特性の用語集 (Rev. A 翻訳版) | 最新英語版 (Rev.B) | 2008年 1月 18日 |
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| パッケージ | ピン数 | CAD シンボル、フットプリント、および 3D モデル |
|---|---|---|
| VQFN (RHA) | 40 | Ultra Librarian |
Analog Engineer's Calc Installer
General calculator tool for analog design support.
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